Richard Henderson d3765835ed exec: Add target-specific tlb bits to MemTxAttrs ...

These bits can be used to cache target-specific data in cputlb
read from the page tables.

Signed-off-by: Richard Henderson <richard.henderson@linaro.org>
Reviewed-by: Peter Maydell <peter.maydell@linaro.org>
Message-id: 20190128223118.5255-5-richard.henderson@linaro.org
Signed-off-by: Peter Maydell <peter.maydell@linaro.org>

2019-02-05 16:52:37 +00:00

..

user

…

address-spaces.h

…

cpu_ldst_template.h

…

cpu_ldst_useronly_template.h

…

cpu_ldst.h

cputlb: Remove static tlb sizing

2019-01-28 07:04:35 -08:00

cpu-all.h

…

cpu-common.h

…

cpu-defs.h

cputlb: Remove static tlb sizing

2019-01-28 07:04:35 -08:00

cputlb.h

…

exec-all.h

accel/tcg: Add cluster number to TCG TB hash

2019-01-29 11:46:06 +00:00

gdbstub.h

…

gen-icount.h

…

helper-gen.h

…

helper-head.h

tcg: Add TCG_CALL_NO_RETURN

2018-12-26 06:40:24 +11:00

helper-proto.h

…

helper-tcg.h

tcg: Add TCG_CALL_NO_RETURN

2018-12-26 06:40:24 +11:00

hwaddr.h

…

ioport.h

…

log.h

…

memattrs.h

exec: Add target-specific tlb bits to MemTxAttrs

2019-02-05 16:52:37 +00:00

memory_ldst_cached.inc.h

…

memory_ldst_phys.inc.h

…

memory_ldst.inc.h

…

memory-internal.h

…

memory.h

memory: add memory_region_flush_rom_device()

2019-01-29 11:46:04 +00:00

poison.h

exec: Add RISC-V GCC poison macro

2018-12-26 06:40:02 +11:00

ram_addr.h

…

ramlist.h

…

semihost.h

…

softmmu-semi.h

…

target_page.h

…

tb-context.h

…

tb-hash.h

…

tb-lookup.h

…

translator.h

…