target/hppa: Implement SHRPD
Signed-off-by: Richard Henderson <richard.henderson@linaro.org>
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commit
f7b775a9c0
@ -332,8 +332,10 @@ addbi 101011 ..... ..... ... ........... . . @rib_cf f=1
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# Shift, Extract, Deposit
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shrpw_sar 110100 r2:5 r1:5 c:3 00 0 00000 t:5
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shrpw_imm 110100 r2:5 r1:5 c:3 01 0 cpos:5 t:5
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shrp_sar 110100 r2:5 r1:5 c:3 00 0 d:1 0000 t:5
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shrp_imm 110100 r2:5 r1:5 c:3 01 0 cpos:5 t:5 d=0
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shrp_imm 110100 r2:5 r1:5 c:3 0. 1 ..... t:5 \
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d=1 cpos=%cpos6_11
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extr_sar 110100 r:5 t:5 c:3 10 se:1 00 000 ..... d=0 len=%len5
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extr_sar 110100 r:5 t:5 c:3 10 se:1 1. 000 ..... d=1 len=%len6_8
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@ -3279,34 +3279,64 @@ static bool trans_movbi(DisasContext *ctx, arg_movbi *a)
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return do_cbranch(ctx, a->disp, a->n, &cond);
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}
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static bool trans_shrpw_sar(DisasContext *ctx, arg_shrpw_sar *a)
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static bool trans_shrp_sar(DisasContext *ctx, arg_shrp_sar *a)
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{
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TCGv_reg dest;
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TCGv_reg dest, src2;
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if (!ctx->is_pa20 && a->d) {
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return false;
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}
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if (a->c) {
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nullify_over(ctx);
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}
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dest = dest_gpr(ctx, a->t);
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src2 = load_gpr(ctx, a->r2);
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if (a->r1 == 0) {
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tcg_gen_ext32u_reg(dest, load_gpr(ctx, a->r2));
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tcg_gen_shr_reg(dest, dest, cpu_sar);
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if (a->d) {
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tcg_gen_shr_reg(dest, src2, cpu_sar);
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} else {
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TCGv_reg tmp = tcg_temp_new();
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||||
tcg_gen_ext32u_reg(dest, src2);
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||||
tcg_gen_andi_reg(tmp, cpu_sar, 31);
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||||
tcg_gen_shr_reg(dest, dest, tmp);
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}
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} else if (a->r1 == a->r2) {
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TCGv_i32 t32 = tcg_temp_new_i32();
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||||
TCGv_i32 s32 = tcg_temp_new_i32();
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if (a->d) {
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||||
tcg_gen_rotr_reg(dest, src2, cpu_sar);
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} else {
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||||
TCGv_i32 t32 = tcg_temp_new_i32();
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||||
TCGv_i32 s32 = tcg_temp_new_i32();
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||||
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||||
tcg_gen_trunc_reg_i32(t32, load_gpr(ctx, a->r2));
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||||
tcg_gen_trunc_reg_i32(s32, cpu_sar);
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||||
tcg_gen_rotr_i32(t32, t32, s32);
|
||||
tcg_gen_extu_i32_reg(dest, t32);
|
||||
tcg_gen_trunc_reg_i32(t32, src2);
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||||
tcg_gen_trunc_reg_i32(s32, cpu_sar);
|
||||
tcg_gen_andi_i32(s32, s32, 31);
|
||||
tcg_gen_rotr_i32(t32, t32, s32);
|
||||
tcg_gen_extu_i32_reg(dest, t32);
|
||||
}
|
||||
} else {
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||||
TCGv_i64 t = tcg_temp_new_i64();
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||||
TCGv_i64 s = tcg_temp_new_i64();
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||||
TCGv_reg src1 = load_gpr(ctx, a->r1);
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||||
tcg_gen_concat_reg_i64(t, load_gpr(ctx, a->r2), load_gpr(ctx, a->r1));
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||||
tcg_gen_extu_reg_i64(s, cpu_sar);
|
||||
tcg_gen_shr_i64(t, t, s);
|
||||
tcg_gen_trunc_i64_reg(dest, t);
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||||
if (a->d) {
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TCGv_reg t = tcg_temp_new();
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TCGv_reg n = tcg_temp_new();
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||||
tcg_gen_xori_reg(n, cpu_sar, 63);
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tcg_gen_shl_reg(t, src2, n);
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tcg_gen_shli_reg(t, t, 1);
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||||
tcg_gen_shr_reg(dest, src1, cpu_sar);
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||||
tcg_gen_or_reg(dest, dest, t);
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} else {
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TCGv_i64 t = tcg_temp_new_i64();
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||||
TCGv_i64 s = tcg_temp_new_i64();
|
||||
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||||
tcg_gen_concat_reg_i64(t, src2, src1);
|
||||
tcg_gen_extu_reg_i64(s, cpu_sar);
|
||||
tcg_gen_andi_i64(s, s, 31);
|
||||
tcg_gen_shr_i64(t, t, s);
|
||||
tcg_gen_trunc_i64_reg(dest, t);
|
||||
}
|
||||
}
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||||
save_gpr(ctx, a->t, dest);
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||||
@ -3318,31 +3348,40 @@ static bool trans_shrpw_sar(DisasContext *ctx, arg_shrpw_sar *a)
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||||
return nullify_end(ctx);
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||||
}
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||||
|
||||
static bool trans_shrpw_imm(DisasContext *ctx, arg_shrpw_imm *a)
|
||||
static bool trans_shrp_imm(DisasContext *ctx, arg_shrp_imm *a)
|
||||
{
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||||
unsigned sa = 31 - a->cpos;
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unsigned width, sa;
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||||
TCGv_reg dest, t2;
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||||
if (!ctx->is_pa20 && a->d) {
|
||||
return false;
|
||||
}
|
||||
if (a->c) {
|
||||
nullify_over(ctx);
|
||||
}
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width = a->d ? 64 : 32;
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sa = width - 1 - a->cpos;
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||||
dest = dest_gpr(ctx, a->t);
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||||
t2 = load_gpr(ctx, a->r2);
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||||
if (a->r1 == 0) {
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||||
tcg_gen_extract_reg(dest, t2, sa, 32 - sa);
|
||||
} else if (TARGET_REGISTER_BITS == 32) {
|
||||
tcg_gen_extract_reg(dest, t2, sa, width - sa);
|
||||
} else if (width == TARGET_REGISTER_BITS) {
|
||||
tcg_gen_extract2_reg(dest, t2, cpu_gr[a->r1], sa);
|
||||
} else if (a->r1 == a->r2) {
|
||||
TCGv_i32 t32 = tcg_temp_new_i32();
|
||||
tcg_gen_trunc_reg_i32(t32, t2);
|
||||
tcg_gen_rotri_i32(t32, t32, sa);
|
||||
tcg_gen_extu_i32_reg(dest, t32);
|
||||
} else {
|
||||
TCGv_i64 t64 = tcg_temp_new_i64();
|
||||
tcg_gen_concat_reg_i64(t64, t2, cpu_gr[a->r1]);
|
||||
tcg_gen_shri_i64(t64, t64, sa);
|
||||
tcg_gen_trunc_i64_reg(dest, t64);
|
||||
assert(!a->d);
|
||||
if (a->r1 == a->r2) {
|
||||
TCGv_i32 t32 = tcg_temp_new_i32();
|
||||
tcg_gen_trunc_reg_i32(t32, t2);
|
||||
tcg_gen_rotri_i32(t32, t32, sa);
|
||||
tcg_gen_extu_i32_reg(dest, t32);
|
||||
} else {
|
||||
TCGv_i64 t64 = tcg_temp_new_i64();
|
||||
tcg_gen_concat_reg_i64(t64, t2, cpu_gr[a->r1]);
|
||||
tcg_gen_shri_i64(t64, t64, sa);
|
||||
tcg_gen_trunc_i64_reg(dest, t64);
|
||||
}
|
||||
}
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||||
save_gpr(ctx, a->t, dest);
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