sp_tlb_flush_*: Avoid run-time check for cpu type/implementation by installing correct function in cache_setup_funcs()
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211b6cbf4d
commit
91a8591307
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@ -1,4 +1,4 @@
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/* $NetBSD: cache.c,v 1.8 2011/06/06 02:49:39 mrg Exp $ */
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/* $NetBSD: cache.c,v 1.9 2014/12/30 18:29:20 palle Exp $ */
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/*
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* Copyright (c) 2011 Matthew R. Green
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@ -35,7 +35,7 @@
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*/
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#include <sys/cdefs.h>
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__KERNEL_RCSID(0, "$NetBSD: cache.c,v 1.8 2011/06/06 02:49:39 mrg Exp $");
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__KERNEL_RCSID(0, "$NetBSD: cache.c,v 1.9 2014/12/30 18:29:20 palle Exp $");
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#include "opt_multiprocessor.h"
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@ -75,6 +75,24 @@ void (*blast_icache)(void) = blast_icache_us;
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void (*sp_dcache_flush_page)(paddr_t) = dcache_flush_page_us;
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#endif
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void (*sp_tlb_flush_pte)(vaddr_t, int) = sp_tlb_flush_pte_us;
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void (*sp_tlb_flush_all)(void) = sp_tlb_flush_all_us;
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static void
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sp_tlb_flush_pte_sun4v(vaddr_t va, int ctx)
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{
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int64_t hv_rc;
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hv_rc = hv_mmu_demap_page(va, ctx, MAP_DTLB|MAP_ITLB);
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||||
if ( hv_rc != H_EOK )
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panic("hv_mmu_demap_page(%p,%d) failed - rc = %" PRIx64 "\n", (void*)va, ctx, hv_rc);
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}
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static void
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sp_tlb_flush_all_sun4v(void)
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{
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panic("sp_tlb_flush_all_sun4v() not implemented yet");
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}
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void
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cache_setup_funcs(void)
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{
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@ -103,4 +121,16 @@ cache_setup_funcs(void)
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}
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#endif
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}
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/* Prepare sp_tlb_flush_* functions */
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if (CPU_ISSUN4V) {
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sp_tlb_flush_pte = sp_tlb_flush_pte_sun4v;
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||||
sp_tlb_flush_all = sp_tlb_flush_all_sun4v;
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} else {
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if (CPU_IS_USIII_UP() || CPU_IS_SPARC64_V_UP()) {
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sp_tlb_flush_pte = sp_tlb_flush_pte_usiii;
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sp_tlb_flush_all = sp_tlb_flush_all_usiii;
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}
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}
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}
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@ -1,4 +1,4 @@
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/* $NetBSD: cache.h,v 1.26 2014/11/05 13:50:50 nakayama Exp $ */
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/* $NetBSD: cache.h,v 1.27 2014/12/30 18:29:20 palle Exp $ */
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||||
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||||
/*
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* Copyright (c) 2011 Matthew R. Green
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@ -118,39 +118,13 @@ void sp_tlb_flush_pte_usiii(vaddr_t, int);
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void sp_tlb_flush_all_us(void);
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void sp_tlb_flush_all_usiii(void);
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static __inline__ void
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sp_tlb_flush_pte_sun4v(vaddr_t va, int ctx)
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{
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int64_t hv_rc;
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||||
hv_rc = hv_mmu_demap_page(va, ctx, MAP_DTLB|MAP_ITLB);
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||||
if ( hv_rc != H_EOK )
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||||
panic("hv_mmu_demap_page(%p,%d) failed - rc = %" PRIx64 "\n", (void*)va, ctx, hv_rc);
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||||
}
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||||
static __inline__ void
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sp_tlb_flush_pte(vaddr_t va, int ctx)
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{
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if (CPU_ISSUN4V)
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sp_tlb_flush_pte_sun4v(va, ctx);
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||||
else if (CPU_IS_USIII_UP() || CPU_IS_SPARC64_V_UP())
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||||
sp_tlb_flush_pte_usiii(va, ctx);
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||||
else
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||||
sp_tlb_flush_pte_us(va, ctx);
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}
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||||
static __inline__ void
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sp_tlb_flush_all(void)
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{
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if (CPU_IS_USIII_UP() || CPU_IS_SPARC64_V_UP())
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||||
sp_tlb_flush_all_usiii();
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else
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||||
sp_tlb_flush_all_us();
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||||
}
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extern void (*dcache_flush_page)(paddr_t);
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extern void (*dcache_flush_page_cpuset)(paddr_t, sparc64_cpuset_t);
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extern void (*blast_dcache)(void);
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extern void (*blast_icache)(void);
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extern void (*sp_tlb_flush_pte)(vaddr_t, int);
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||||
extern void (*sp_tlb_flush_all)(void);
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||||
void cache_setup_funcs(void);
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